崗位職責:
1.負責FPGA邏輯的總體設計及詳細設計,編寫FPGA設計文檔、測試文檔等;
2.負責搭建FPGA邏輯開發的軟件環境及仿真平臺,FPGA邏輯的仿真和調試;
3.負責FPGA的板上調試,協助完成系統集成測試;
4.負責FPGA邏輯開發過程的設計、測試等文檔的編寫。
任職要求:
1. 電子信息工程、通信工程、物理學與電子工程等相關專業,本科及以上學歷;
2.熟悉 VerilogHDL或VHDL硬件描述語言;
3. 具備Xilinx、Altera等公司的產品開發環境,熟悉相關開發、仿真、綜合流程;
4. 具有數字濾波、高速ADC開發經驗優先;
5.了解半導體探測器并具備相關產品應用經驗者優先;
6. 較強的責任感,工作積極主動,具備良好的團隊協作精神;
7.較強的溝通能力和學習能力。
公司與棗莊市創新研究院簽署有人才共引共用協議,條件符合及工作能力者,可享受創新研究院事業編制身份。
根據棗莊市人才補貼政策,與我司簽訂3年以上勞動合同并繳納社會保險者,基于補貼連續發放3年,其中博士畢業生(≤45歲)5000元/月,碩士畢業生(≤35歲)2000元/月,本科畢業生(擇業期內)1000元/月。享受購買首套住房補貼:博士畢業生20萬元,碩士畢業生(畢業五年內)5萬元,本科畢業生(畢業5年內)2萬元。
職位福利:五險一金、加班補助、周末雙休、節日福利
職位亮點:條件符合工作能力優秀者,可享受事業編制