職位描述
Verilog HDL原理圖設計通信/網絡設備
【崗位職責】
1.負責FPGA系統工程搭建與開發。
2.負責FPGA邏輯算法、接口協議、控制邏輯的需求分析、開發和測試驗證。
3.具備軟件開發文檔編寫能力。
【崗位要求】
1.軟件工程、計算機科學技術、通信工程、電氣工程等相關專業本科以上學歷。
2.1年以上相關FPGA開發經驗。
3.熟悉AXI接口、信號調制解調、總線通信等功能。
4.熟練使用Verilog或VHDL開發語言。
5.熟悉Xilinx、復旦微等公司軟件開發平臺，熟悉Vivado等開發軟件。
6.具有高速ADC/DAC采集控制算法經驗優先。
職位福利：節日福利、五險一金、績效獎金、帶薪年假、定期體檢、員工旅游、公司重點項目
工作地點
煙臺芝罘區興園路16號九七大廈五層
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山東嘉航電子信息技術有限公司
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職位發布者
趙杰/研發部長
處理簡歷快立即溝通
山東嘉航電子信息技術有限公司山東嘉航電子信息技術有限公司（簡稱嘉航技術，英文縮寫JHEIT）成立于2014年。是一家集科研與生產為一體的電子信息技術研發創新型國家級高新技術企業。公司坐落于山東煙臺，主要從事嵌入式計算機、電子、通信、導航、儀器儀表等產品的研究與開發，業務范圍涵蓋衛星應用、電子信息、智能處理、軟件開發四個領域，涉及軍用、航天、航空、兵器、船舶、特種車輛、軌道交通、工程機械等多個市場。核心團隊成員擁有多年的軍工產品研制經驗。公司獲得市級科技獎勵多項，擁有36項自有知識產權，承擔國家各級科研項目。2019年11月認定【高新技術企業】；2021年4月認定為【煙臺市首批市級工業設計中心】。2021年9月由工業和信息化部主辦，中國信息通信研究院和應急通信產業聯盟共同承辦的“2021年應急通信產業發展高峰論壇”在北京國家會議中心舉行我司榮獲【應急通信優秀解決方案三等獎】。嘉航技術愿與您一道攜手，一起成長，一起走向成功！因業務發展需要，現誠聘通信工程、電子信息工程、計算機科學與技術、軟件工程及機械電子工程等相關專業的應屆畢業生（含本科及碩士研究生）及具有工作經驗科研人員，崗位涵蓋嵌入式軟件、硬件研發、射頻研發、機電研發、衛星互聯網研發等設計崗位，
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