職位描述
Verilog HDLVHDLSystem VerilogRTL電子/半導體/集成電路
崗位要求：
a.專業知識：
a)熟練使用office、WPS等辦公軟件；
b)熟悉SoC芯片設計流程；
c)掌握相關編程語言（如Verilog、VHDL、SystemVerilog）；
d)熟練使用EDA工具；
e)掌握狀態機提取以及到代碼的轉換。
b.項目經驗：
a)具備數字集成電路相關項目獨立設計的經驗，也可以是FPGA設計；
b)參與過已流片的項目，并在其中擔任設計工程師角色；
c)至少1年工作經驗。
c.學歷：本科及以上
a.專業知識：
a)熟練使用office、WPS等辦公軟件；
b)熟悉SoC芯片設計流程；
c)掌握相關編程語言（如Verilog、VHDL、SystemVerilog）；
d)熟練使用EDA工具；
e)掌握狀態機提取以及到代碼的轉換。
b.項目經驗：
a)具備數字集成電路相關項目獨立設計的經驗，也可以是FPGA設計；
b)參與過已流片的項目，并在其中擔任設計工程師角色；
c)至少1年工作經驗。
c.學歷：本科及以上
崗位職責：
a.芯片概要設計文檔編寫；
b.芯片安全性、可靠性、測試性分析工作；
c.需求到概要設計文檔的雙向追蹤；
d.概要設計文檔到RTL代碼的雙向追蹤；
e.代碼規則檢查及分析。
a.芯片概要設計文檔編寫；
b.芯片安全性、可靠性、測試性分析工作；
c.需求到概要設計文檔的雙向追蹤；
d.概要設計文檔到RTL代碼的雙向追蹤；
e.代碼規則檢查及分析。
工作地點
雁塔區西安電子科技大學(北校區)1
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職位發布者
張女士/HR
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