職位描述
Verilog HDL通信/網絡設備電子/半導體/集成電路
崗位職責：
1、技術路線規劃：參與公司平臺的FPGA技術路線規劃，不斷完善公司產品的技術架構。參與項目的整體規劃與實施，實現功能劃分，主導部門內項目任務的分解。負責產品的FPGA架構設計、功能開發、質量保障。
2、團隊領導：帶領團隊完成FPGA研發工作，包括方案設計、邏輯開發以及仿真驗證，系統的板級調試，定位問題并修改。 組織技術攻關，解決核心技術問題和積累技術經驗，不斷維護和迭代產品。
3、團隊建設與人員培養：負責FPGA團隊建設、人員培養，重大難點技術突破。負責本部門開發規范及流程規范建設。參與產品需求分析和定義，負責FPGA需求分析與分解。
4、算法開發：負責圖像算法增強、去霧處理、圖像拼接、圖像融合等圖像處理算法研究與實現；如ST2110等格式的編解碼和傳輸。以及視頻壓縮算法和視頻圖像的優化調整。
5、技術調研與預研：負責FPGA相關技術的調研、預研和原型驗證工作。
任職要求：
1、研究生學歷，電子工程、微電子、通信、信號處理或計算機等相關專業；
2、5年以上FPGA開發經驗；
3、至少兩個大型FPGA項目或SoPC完整開發經驗，豐富的板級調試經驗；4、熟練掌握FPGA開發全流程，包括需求分析、方案設計、邏輯開發和上板調試；
5、編程語言精通：精通Verilog語言，熟練使用Vivado、ISE、Modelim、Matlab等工具。有PCIe、DDR、RapiodIO、NVME、erde等高速接口開發經驗；
6、熱情與學習能力：對FPGA有較強的熱情，熟悉FPGA行業前沿動態，對新的技術和方法學學習能力強；
7、熟悉FPGA硬件及視頻接口芯片電路；熟悉EMC、信號質量和完整性等；
8、熟悉常用的圖像處理算法，有圖像增強，格式轉換，圖像縮放、ISP等視頻圖像處理經驗優先考慮；
工作地點
成都武侯區數字經濟大廈15樓
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陳先生/招聘主管
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